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| author | Jack Rosenthal <jrosenth@chromium.org> | 2022-06-27 14:24:08 -0600 |
|---|---|---|
| committer | Chromeos LUCI <chromeos-scoped@luci-project-accounts.iam.gserviceaccount.com> | 2022-06-29 03:45:56 +0000 |
| commit | fd7957c9ed1ce6ce7770697d2013af3b3fc55ffa (patch) | |
| tree | 97ff7068e1055f555ab5d100c306c36c033b38ee /chip/npcx/gpio_chip-npcx5.h | |
| parent | f7f05bb09be506f55e3b7991af8a3c9f0ceee90f (diff) | |
| download | chrome-ec-fd7957c9ed1ce6ce7770697d2013af3b3fc55ffa.tar.gz | |
chip/npcx/gpio_chip-npcx5.h: Format with clang-format
BUG=b:236386294
BRANCH=none
TEST=none
Change-Id: I642db0b7dbf173f5b4b49d94e1d1fffaf456d8bc
Signed-off-by: Jack Rosenthal <jrosenth@chromium.org>
Reviewed-on: https://chromium-review.googlesource.com/c/chromiumos/platform/ec/+/3729395
Reviewed-by: Jeremy Bettis <jbettis@chromium.org>
Diffstat (limited to 'chip/npcx/gpio_chip-npcx5.h')
| -rw-r--r-- | chip/npcx/gpio_chip-npcx5.h | 227 |
1 files changed, 120 insertions, 107 deletions
diff --git a/chip/npcx/gpio_chip-npcx5.h b/chip/npcx/gpio_chip-npcx5.h index 83916a421b..5d6170affa 100644 --- a/chip/npcx/gpio_chip-npcx5.h +++ b/chip/npcx/gpio_chip-npcx5.h @@ -245,7 +245,7 @@ #define NPCX_ALT_GPIO_B_1 ALT(B, 1, NPCX_ALT_INV(A, NO_KSO17_SL)) /* KSO17 */ /* Clock module */ -#define NPCX_ALT_GPIO_7_5 ALT(7, 5, NPCX_ALT(A, 32K_OUT_SL)) /* 32KHZ_OUT */ +#define NPCX_ALT_GPIO_7_5 ALT(7, 5, NPCX_ALT(A, 32K_OUT_SL)) /* 32KHZ_OUT */ #define NPCX_ALT_GPIO_E_7 ALT(E, 7, NPCX_ALT(A, 32KCLKIN_SL)) /* 32KCLKIN */ /* PS/2 module */ @@ -261,124 +261,137 @@ #define NPCX_ALT_GPIO_A_7 #endif -#define NPCX_ALT_TABLE { \ - NPCX_ALT_GPIO_0_3 /* KSO16 */ \ - NPCX_ALT_GPIO_0_4 /* KSO13 */ \ - NPCX_ALT_GPIO_0_5 /* KSO12 */ \ - NPCX_ALT_GPIO_0_6 /* KSO11 */ \ - NPCX_ALT_GPIO_0_7 /* KSO10 */ \ - NPCX_ALT_GPIO_1_0 /* KSO09 & CR_SOUT */ \ - NPCX_ALT_GPIO_1_1 /* KSO08 & CR_SIN */ \ - NPCX_ALT_GPIO_1_2 /* KSO07 */ \ - NPCX_ALT_GPIO_1_3 /* KSO06 */ \ - NPCX_ALT_GPIO_1_4 /* KSO05 */ \ - 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*/ \ - NPCX_ALT_GPIO_E_7 /* 32KCLKIN */ \ -} +#define NPCX_ALT_TABLE \ + { \ + NPCX_ALT_GPIO_0_3 /* KSO16 */ \ + NPCX_ALT_GPIO_0_4 /* KSO13 */ \ + NPCX_ALT_GPIO_0_5 /* KSO12 */ \ + NPCX_ALT_GPIO_0_6 /* KSO11 */ \ + NPCX_ALT_GPIO_0_7 /* KSO10 */ \ + NPCX_ALT_GPIO_1_0 /* KSO09 \ + & CR_SOUT */ \ + NPCX_ALT_GPIO_1_1 /* KSO08 & CR_SIN */ \ + NPCX_ALT_GPIO_1_2 /* KSO07 */ \ + NPCX_ALT_GPIO_1_3 /* KSO06 */ \ + NPCX_ALT_GPIO_1_4 /* KSO05 */ \ + NPCX_ALT_GPIO_1_5 /* KSO04 */ \ + NPCX_ALT_GPIO_1_6 /* KSO03 */ \ + NPCX_ALT_GPIO_1_7 /* KSO02 */ \ + NPCX_ALT_GPIO_2_0 /* KSO01 */ \ + NPCX_ALT_GPIO_2_1 /* KSO00 */ \ + NPCX_ALT_GPIO_2_2 /* KSI7 */ \ + NPCX_ALT_GPIO_2_3 /* KSI6 */ \ + NPCX_ALT_GPIO_2_4 /* KSI5 */ \ + NPCX_ALT_GPIO_2_5 /* KSI4 */ \ + NPCX_ALT_GPIO_2_6 /* KSI3 */ \ + NPCX_ALT_GPIO_2_7 /* KSI2 */ \ + NPCX_ALT_GPIO_3_0 /* KSI1 */ \ + NPCX_ALT_GPIO_3_1 /* KSI0 */ \ + NPCX_ALT_GPIO_3_4 /* PS2_DAT2 */ \ + NPCX_ALT_GPIO_3_7 /* PS2_CLK2 */ \ + NPCX_ALT_GPIO_4_0 /* TA1_SEL1 */ \ + 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PS2_DAT3 */ \ + NPCX_ALT_GPIO_B_1 /* KSO17 */ \ + NPCX_ALT_GPIO_B_2 /* SMB0SDA1 */ \ + NPCX_ALT_GPIO_B_3 /* SMB0SCL1 */ \ + NPCX_ALT_GPIO_B_4 /* SMB0SDA0 */ \ + NPCX_ALT_GPIO_B_5 /* SMB0SCL0 */ \ + NPCX_ALT_GPIO_B_6 /* PWM4 */ \ + NPCX_ALT_GPIO_B_7 /* PWM5 */ \ + NPCX_ALT_GPIO_C_0 /* PWM6 */ \ + NPCX_ALT_GPIO_C_2 /* PWM1 */ \ + NPCX_ALT_GPIO_C_3 /* PWM0 */ \ + NPCX_ALT_GPIO_C_4 /* PWM2 */ \ + NPCX_ALT_GPIO_D_0 /* SMB3SDA */ \ + NPCX_ALT_GPIO_D_1 /* SMB3SCL */ \ + NPCX_ALT_GPIO_E_7 /* 32KCLKIN */ \ + } /*****************************************************************************/ /* Macro functions for Low-Voltage mapping table */ /* Low-Voltage GPIO Control 0 */ -#define NPCX_LVOL_CTRL_0_0 NPCX_GPIO(B, 5) -#define NPCX_LVOL_CTRL_0_1 NPCX_GPIO(B, 4) -#define NPCX_LVOL_CTRL_0_2 NPCX_GPIO(B, 3) -#define NPCX_LVOL_CTRL_0_3 NPCX_GPIO(B, 2) -#define NPCX_LVOL_CTRL_0_4 NPCX_GPIO(9, 0) -#define NPCX_LVOL_CTRL_0_5 NPCX_GPIO(8, 7) -#define NPCX_LVOL_CTRL_0_6 NPCX_GPIO(0, 0) -#define NPCX_LVOL_CTRL_0_7 NPCX_GPIO(3, 3) +#define NPCX_LVOL_CTRL_0_0 NPCX_GPIO(B, 5) +#define NPCX_LVOL_CTRL_0_1 NPCX_GPIO(B, 4) +#define NPCX_LVOL_CTRL_0_2 NPCX_GPIO(B, 3) +#define NPCX_LVOL_CTRL_0_3 NPCX_GPIO(B, 2) +#define NPCX_LVOL_CTRL_0_4 NPCX_GPIO(9, 0) +#define NPCX_LVOL_CTRL_0_5 NPCX_GPIO(8, 7) +#define NPCX_LVOL_CTRL_0_6 NPCX_GPIO(0, 0) +#define NPCX_LVOL_CTRL_0_7 NPCX_GPIO(3, 3) /* Low-Voltage GPIO Control 1 */ -#define NPCX_LVOL_CTRL_1_0 NPCX_GPIO(9, 2) -#define NPCX_LVOL_CTRL_1_1 NPCX_GPIO(9, 1) -#define NPCX_LVOL_CTRL_1_2 NPCX_GPIO(D, 1) -#define NPCX_LVOL_CTRL_1_3 NPCX_GPIO(D, 0) -#define NPCX_LVOL_CTRL_1_4 NPCX_GPIO(3, 6) -#define NPCX_LVOL_CTRL_1_5 NPCX_GPIO(6, 4) -#define NPCX_LVOL_CTRL_1_6 NPCX_GPIO(6, 5) -#define NPCX_LVOL_CTRL_1_7 NPCX_GPIO_NONE +#define NPCX_LVOL_CTRL_1_0 NPCX_GPIO(9, 2) +#define NPCX_LVOL_CTRL_1_1 NPCX_GPIO(9, 1) +#define NPCX_LVOL_CTRL_1_2 NPCX_GPIO(D, 1) +#define NPCX_LVOL_CTRL_1_3 NPCX_GPIO(D, 0) +#define NPCX_LVOL_CTRL_1_4 NPCX_GPIO(3, 6) +#define NPCX_LVOL_CTRL_1_5 NPCX_GPIO(6, 4) +#define NPCX_LVOL_CTRL_1_6 NPCX_GPIO(6, 5) +#define NPCX_LVOL_CTRL_1_7 NPCX_GPIO_NONE /* Low-Voltage GPIO Control 2 */ -#define NPCX_LVOL_CTRL_2_0 NPCX_GPIO(7, 4) -#define NPCX_LVOL_CTRL_2_1 NPCX_GPIO(8, 4) -#define NPCX_LVOL_CTRL_2_2 NPCX_GPIO(8, 5) -#define NPCX_LVOL_CTRL_2_3 NPCX_GPIO(7, 3) -#define NPCX_LVOL_CTRL_2_4 NPCX_GPIO(C, 1) -#define NPCX_LVOL_CTRL_2_5 NPCX_GPIO(C, 7) -#define NPCX_LVOL_CTRL_2_6 NPCX_GPIO(E, 7) -#define NPCX_LVOL_CTRL_2_7 NPCX_GPIO(3, 4) +#define NPCX_LVOL_CTRL_2_0 NPCX_GPIO(7, 4) +#define NPCX_LVOL_CTRL_2_1 NPCX_GPIO(8, 4) +#define NPCX_LVOL_CTRL_2_2 NPCX_GPIO(8, 5) +#define NPCX_LVOL_CTRL_2_3 NPCX_GPIO(7, 3) +#define NPCX_LVOL_CTRL_2_4 NPCX_GPIO(C, 1) +#define NPCX_LVOL_CTRL_2_5 NPCX_GPIO(C, 7) +#define NPCX_LVOL_CTRL_2_6 NPCX_GPIO(E, 7) +#define NPCX_LVOL_CTRL_2_7 NPCX_GPIO(3, 4) /* Low-Voltage GPIO Control 3 */ -#define NPCX_LVOL_CTRL_3_0 NPCX_GPIO(C, 6) -#define NPCX_LVOL_CTRL_3_1 NPCX_GPIO(3, 7) -#define NPCX_LVOL_CTRL_3_2 NPCX_GPIO(4, 0) -#define NPCX_LVOL_CTRL_3_3 NPCX_GPIO(7, 1) -#define NPCX_LVOL_CTRL_3_4 NPCX_GPIO(8, 2) -#define NPCX_LVOL_CTRL_3_5 NPCX_GPIO(7, 5) -#define NPCX_LVOL_CTRL_3_6 NPCX_GPIO(8, 0) -#define NPCX_LVOL_CTRL_3_7 NPCX_GPIO(C, 5) +#define NPCX_LVOL_CTRL_3_0 NPCX_GPIO(C, 6) +#define NPCX_LVOL_CTRL_3_1 NPCX_GPIO(3, 7) +#define NPCX_LVOL_CTRL_3_2 NPCX_GPIO(4, 0) +#define NPCX_LVOL_CTRL_3_3 NPCX_GPIO(7, 1) +#define NPCX_LVOL_CTRL_3_4 NPCX_GPIO(8, 2) +#define NPCX_LVOL_CTRL_3_5 NPCX_GPIO(7, 5) +#define NPCX_LVOL_CTRL_3_6 NPCX_GPIO(8, 0) +#define NPCX_LVOL_CTRL_3_7 NPCX_GPIO(C, 5) /* 4 Low-Voltage Control Groups on npcx5 */ -#define NPCX_LVOL_TABLE { { NPCX_LVOL_CTRL_ITEMS(0), }, \ - { NPCX_LVOL_CTRL_ITEMS(1), }, \ - { NPCX_LVOL_CTRL_ITEMS(2), }, \ - { NPCX_LVOL_CTRL_ITEMS(3), }, } +#define NPCX_LVOL_TABLE \ + { \ + { \ + NPCX_LVOL_CTRL_ITEMS(0), \ + }, \ + { \ + NPCX_LVOL_CTRL_ITEMS(1), \ + }, \ + { \ + NPCX_LVOL_CTRL_ITEMS(2), \ + }, \ + { \ + NPCX_LVOL_CTRL_ITEMS(3), \ + }, \ + } #endif /* __CROS_EC_GPIO_CHIP_NPCX5_H */ |